黎煥欣的工作部落格

2008-08-03 相位差測試模組

黎煥欣 Li Huan Hsin

數位相關器的基本測試就是用 LO+IF+DELAY LINE 產生相位延遲, 讓 DC 產生 fringe, 這整個測試把它模組化是很方便的, 下面是模組化的過程.

學弟先把 YIG 的 driver 板固定

2008-08-02 4 Band DC (14) DAQ_Srv and DAQ_Moni

黎煥欣

為了這次新的組態, 四個 band 的資料都由一台 pc 收集, 做 I/O 動作己經吃掉它 70~80% 的能量, 無法負擔太多的 UI, 所以把 DAQ 及監看程式分開由兩台電腦執行. 一個是 DAQ_Srv, 一個是 DAQ_Moni, 正常來說, 它是在兩台 pc 上跑的, 用網路通訊傳送少量資料, 但可以較完整的資料呈現出來

下圖是 DAQ_Srv. 一般它要先執行.

2008-08-03 經驗小品 (7) VB8 下的字串與陣列轉換

黎煥欣 Li Huan Hsin

在 VB8 下(過往也有同樣的問題, 不過寫寫一些 "低階" 副程式或 "API" 就都解決了) 標榜所有的功能它都有內建. 所以以前有關字串與陣列, 與陣列之間的型態互換. 都有對應的程式. 這在一般的 VB8 (VB2005) 的書上可是看不到的..... 總之, 看了很久的 Help , 總算得到一些心得...

在 VB8 中有關 I/O 的部份, 包括 RS232/filestream/TCPIP, 若要使用它們的高效能程式, 基底操作函式都是 byte 陣列運作的. 下面是幾個範例:

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2008-07-28 4 Band DC 程式, 檔案格式及監控協定

黎煥欣  Li Huan Hsin

這次的 DC 因為四個 band 一起作, 而且最後決定是由一台單獨的 PC 做資料收集的動作.  所以 DAQ 程式有大幅的修改, 而且根據前一個版本的經驗, 會有丟資料的情形. 而且 DAQ 的負擔非常重, UI 部份不能再放在 DAQ 內, 而用另外一個電腦在跑另外一個程式來監看 real time 的 DATA. 程式名稱將再修訂. 目前 (07-28) 定出來的版本

FPGA_Program_Panel   -> 寫入及監看 FPGA 狀態的程式

2008-07-26 經驗小品 (6) 使用 demux3950 產生同步 clock

黎煥欣 Li Huan Hsin

在 NTU array 系統中到處都要僅可能的使用同步性高的時鐘信號. 當然現在設計的所有 clock 都是由單一的 8.7G YIG 來的. 最重要的是由它除 32 得來的 271MHz, 也是要高度的相位同步. 於是想到用 demux 3950 + N6B23 除法器 (除 2 模式) 配合, 可以得到 8.7G 等級同步的多輸出 271MHz clock.

配置如下圖, 8.7GHz 的時鐘信號輸入後, 它自己的 PCLK 為同步於 8.7GHz 的 543MHz, 經過除 2 後, 送回 demux 自行取樣. 那當然會同時取到 16 個 0, 接著再同時取到 16 個 1, 其中可能最多有 2 個輸出會在邊緣而不能用, 但至少有 14 個輸出可以用.

2008-07-26 4 Band DC (13) 裝置與程式記事

黎煥欣  Li Husn Hsin

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8.7G Clock 分配器安裝, 原來是歪著的.

2008-07-26 4Band DC (12) 特性測量 Cable 與 Power Divider

黎煥欣 Li Huan Hsin

因為要確認各個使用中的零件特性, 我們測試了 Cable 及老師帶回來的 1 對 4 power divider 的特性, 特別在我們幾個常使用旳頻率. 看它的衰減特性.

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2008-07-19 4 Band DC (11) 除錯與修復

黎煥欣 Li Huan Hsin

用前篇經驗小品的控制項陣列, 可以方便的寫出一大堆的 port 操作. 當然就可以測試硬體是否正常, 一開始全部把它們裝在一起, 全開了. 從 pattern 就知道有人有問題了.

2008-08-19 經驗小品 (5) VB8 下的自訂控制項陣列

黎煥欣  Li Huan Hsin

在做 NTU Array 的時候, 我們使用一大堆的 USB Serial port 來接收資料, 以現在 4 個 DC 的情況而言, FT 板有 36 個, Co  板有 16 個, 而且有時會裝, 有時不會在線上. 若是用傳統寫法, 全部都在設計階段放上去, 那寫起來及設計都非常難過. 後來翻了半天的書及線上 HELP, 總算整理並實際寫出一個可變性的控制程式.  下面就是範例

2008-08-18 4band DC (10) 雜項製作

黎煥欣 Li Huan Hsin

整個 4 band 系統還是有很多東西需要補足或 Modify 的更好. 系統的 clock 核心來源 YIG OSC, 它的頻率調整就要加上一個 Dial 轉盤. 這個 YIG 控制器是顏易程做的, 幾個 YIG 控制器中, 就數它的最 compact.